Studienhandbuch der JKU Linz
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Technische Informatik
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KV
Hardwareentwurf mit VHDL
Versionsauswahl
Version
2017W
Es ist eine neuere Version
2023W
dieser LV im Curriculum Masterstudium Elektronik und Informationstechnik (ELIT) 2024W vorhanden.
Workload
Ausbildungslevel
Studienfachbereich
VerantwortlicheR
Semesterstunden
Anbietende Uni
3 ECTS
B3 - Bachelor 3. Jahr
Informationselektronik
Robert Wille
2 SSt
Johannes Kepler Universität Linz
Detailinformationen
Quellcurriculum
Bachelorstudium Elektronik und Informationstechnik 2017W
Ziele
Vermittlung der wesentliche Schritte im Entwurf von elektronischen Schaltungen mit VHDL
Lehrinhalte
Hardwarebeschreibungssprachen, Entwicklung & Überblick
Y-Diagramm und VHDL
VHDL Syntax
VHDL Modelle
VHDL Simulation Cycle
Testbench
Synthese
Beurteilungskriterien
schriftliche und/oder mündliche Prüfung, schriftliche Übungsabgaben
Lehrmethoden
Vortrag und Übungen
Abhaltungssprache
Deutsch
Lehrinhalte wechselnd?
Nein
Präsenzlehrveranstaltung
Teilungsziffer
35
Zuteilungsverfahren
Zuteilung nach Reihenfolge